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  • HSI (High-Speed Interface) PHY System Design Validation Engineer 面試心得
  • 企業名 聯發科技股份有限公司
  • 工作地點 新竹市東區
  • 薪資 面議（經常性薪資達4萬元或以上）0~0元
  • 工作內容 -規劃並執行高速介面（如 PCIe, USB, DP, UFS, CSI, UCIe）IP PHY 驗證。 -建立並維護測試平台，進行 System 與 Electrical 測試。 -使用 Scope, BERT, LA, Signal Analyzer 等儀器進行 Signal Integrity 與 Compliance Test。 -分析測試結果，協助 DE 及 SW 團隊解決問題。 -設計並開發硬體 PCB 評估板，支援系統驗證。
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  • Design Verification Engineer 面試心得
  • 企業名 聯發科技股份有限公司
  • 工作地點 新竹市東區
  • 薪資 面議（經常性薪資達4萬元或以上）0~0元
  • 工作內容 As deep sub-micron process requires longer research cycle and higher manufacture cost, DV(design verification) has become an inevitable part of design group in Mediatek chip development flow. CDG DV is in charge of development and implementation of smart phone, TV, and ASIC product line verification plan. It included: integrated simulation/verification env development, big data analysis and efficiency improvement, bus fabric / EMI (External memory interface ) / Low power functions verification plan and implementation Need to build up verification plan/bench and continuously improve methodology, and you will understand both detail scenario and global view of cell phone/ASIC operating schemes Need to leverage the latest EDA tool and concept to accomplish the verification plan Work location: Hsinchu/Taipei
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  • Advanced Substrate/PCB technology Expert​ 面試心得
  • 企業名 聯發科技股份有限公司
  • 工作地點 新竹市東區
  • 薪資 面議（經常性薪資達4萬元或以上）0~0元
  • 工作內容 1. New SBT vendor bring up , New SBT vendor YIP , troubleshooting and Ops ​ 2. 3D, 3.5D & e-IVR Technology Enabling, CPC/CPO technology building block development​ 3. Common strip format unification management ​ 4. Advanced PCB Ultra-Large size. I.e., CoWoP, DCAI PCB w/ high layer counts (PCB vendor ISU, GCE, UMTC, VGT ) ​ 5. PCB technology development and DRM owner
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  • 115年度暑期實習_數位IC設計_Digital circuit design (新竹) 面試心得
  • 企業名 聯發科技股份有限公司
  • 工作地點 新竹市東區
  • 薪資 月薪29500~48000元
  • 工作內容 (請留意：為加快面試安排時間，僅限定投遞5個職缺)我們在找這樣的你：對行動通訊、無線及寛頻連結、家庭娛樂晶片解決方案有濃厚興趣；勇於表達意見，以團隊成功為目標，面對困難不輕易放棄，總是在想更好的做法，擁有創新及不斷學習的精神。聯發科技邀請您，與全球最頂尖的菁英一同合作，彼此激盪最新的創意與解法，共同挑戰每一個不可能。
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  • ＜Data center＞數位IC設計工程師_台北 (SOC BE) 面試心得
  • 企業名 聯發科技股份有限公司
  • 工作地點 台北市內湖區
  • 薪資 月薪29500~48000元
  • 工作內容 1. 優化數位 IC 設計 BE 流程與方法 2. 執行與管理數位 IC 設計 BE 相關任務 (2.a) Physical aware synthesis, DFT-SCAN, DFT-MBIST insertion (2.b) STA timing analysis 與 fixing (2.c) Netlist level QC，例如 CLP 3. 與 FE RTL designer 及 PD APR 團隊密切合作，針對 PPA（Performance, Power, Area）進行 design 及 clock structure 的優化 4. 將依應徵者的年資與專業經驗，提供不同的職級
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  • ＜Data center＞資深數位設計及IP整合工程師 面試心得
  • 企業名 聯發科技股份有限公司
  • 工作地點 新竹市東區
  • 薪資 月薪29500~48000元
  • 工作內容 1. Own the top-level integration of internal and third-party IPs into SOC or FPGA platform. 2. Ensure interface compatibility, clock/reset domain correctness. Resolve integration issues including timing, CDC/RDC, and floorplan. 3. Work closely with architect to define specification, support physical design team through synthesis constraints and integration guidance, partner with firmware and validation teams to ensure smooth bring-up and validation.
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